MC14042B

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Quad Transparent Latch

制造商：ON

中文数据手册

产品信息

The MC14042B Quad Transparent Latch is constructed with MOS P-channel and N-channel enhancement mode devices in a single monolithic structure. Each latch has a separate data input, but all four latches share a common clock. The clock polarity (high or low) used to strobe data through the latches can be reversed using the polarity input. Information present at the data input is transferred to outputs Q and Q during the clock level which is determined by the polarity input. When the polarity input is in the logic "0" state, data is transferred during the low clock level, and when the polarity input is in the logic "1" state the transfer occurs during the high clock level.

Buffered Data Inputs
Common Clock
Clock Polarity Control
Q and Qbar Outputs
Double Diode Input Protection
Supply Voltage Range = 3.0 Vdc to 1 8 Vdc
Capable of Driving Two Low-power TTL Loads or One Low-power Schottky TTL Load Over the Rated Temperature Range
Pb-Free Packages are Available*

电路图、引脚图和封装图

MC14042B电路图

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型号	制造商	描述	购买
NLV14042BDG	ON		立即购买
NLV14042BDR2G	ON		立即购买
MC14042BDR2G	ON		立即购买
MC14042BDG	ON	MC14042B 四路透明锁存在一个单片结构中使用 MOS P 沟道和 N 沟道增强模式器件构造。每个锁存均具有单独的数据输入，但所有四个锁存共享一个公共时钟。用于通过锁存频闪数据的时钟极性（高电平或低电平）可以使用极性输入进行保留。数据输入处呈现的信息在极性输入确定的时钟电平期间传输到输出 Q 和 Q。当极性输入为逻辑“0”状态时，数据在时钟低电平期间进行传输，当极性输入为逻辑“1”状态时，在时钟高电平期间进行传输。	立即购买

技术资料

标题	类型	大小（KB）	下载
Quad Transparent Latch	PDF	95	点击下载
IBIS Model for MC14042BCP	UNKNOW	5	点击下载
IBIS Model for MC14042BD	UNKNOW	5	点击下载
SOIC 16 LEAD	PDF	37	点击下载
MC14042B_PKG.GIF	UNKNOW	13	点击下载

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