NB7L32M

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÷·2 Divider with CML Output

制造商：ON

中文数据手册

产品信息

The NB7L32M is an integrated /2 divider with differential clock inputs and asynchronous reset.
Differential clock inputs incorporate internal 50 Ω termination resistors and accept LVPECL (Positive ECL), CML, or LVDS. The high frequency reset pin is asserted on the rising edge. Upon power-up, the internal flip-flops will attain a random state; the reset allows for the synchronization of multiple NB7L32M's in a system.
The differential 16 mA CML output provides matching internal 50 Ω termination which guarantees 400 mV output swing when externally receiver terminated 50 Ω to VCC (See Figure 16).
The device is housed in a small 3x3 mm 16 pin QFN package.

Maximum Input Clock Frequency 14 GHz Typical
200 ps Max Propagation Delay
30 ps Typical Rise and Fall Times
Operating Range: V
= 2.375 V to 3.465 V with V
= 0 V
CML Output Level (400 mV Peak-to-Peak Output), Differential Output Only
50 Ω Internal Input and Output Termination Resistors
Functionally Compatible with Existing 2.5 V / 3.3 V LVEL, LVEP, EP, and SG Devices
Full RoHS Compliance.

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型号	制造商	描述	购买
NB7L32MMNG	ON	IC CLOCK DIVIDER 1:2 16-QFN	立即购买
NB7L32MMNR2G	ON	LOW SKEW CLOCK DRIVER	立即购买

技术资料

标题	类型	大小（KB）	下载
AC Characteristics of ECL Devices	PDF	896	点击下载
Storage and Handling of Drypack Surface Mount Device	PDF	49	点击下载
Clock Generation and Clock and Data Marking and Ordering Information Guide	PDF	71	点击下载
Board Mounting Notes for Quad Flat-Pack No-Lead Package (QFN)	PDF	40	点击下载
GigaComm (SiGe) SPICE Modeling Kit	PDF	157	点击下载
2.5V/3.3V, 14GHz ÷2 Clock Divider w/CML Output and Internal Termination	PDF	183	点击下载
IBIS Model for NB7L32M	UNKNOW	24	点击下载
QFN16, 3x3, 0.5P	PDF	55	点击下载

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