MC10E143

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5.0 V ECL 9-Bit Hold Register

制造商：ON

中文数据手册

产品信息

The MC10E/100E143 is a 9-bit holding register, designed with byte-parity applications in mind. The E143 holds current data or loads new data, with the nine inputs D0-D8 accepting parallel input data.
The SEL (Select) input pin is used to switch between the two modes of operationHOLD and LOAD. Input data is accepted by the registers a set-up time before the positive going edge of CLK1 or CLK2. A HIGH on the Master Reset pin (MR) asynchronously resets all the registers to zero.
The 100 Series contains temperature compensation.

700MHz Min. Operating Frequency
9-Bit for Byte-Parity Applications
Asynchronous Master Reset
Dual Clocks
PECL Mode Operating Range: V
= 4.2 V to 5.7 V with V
= 0 V
75k
Input Pulldown Resistors
NECL Mode Operating Range: V
= 0 V with V
= -4.2 V to -5.7 V
Internal Input Pulldown Resistors
ESD Protection: > 2 KV HBM, > 200 V MM
Meets or Exceeds JEDEC Spec EIA/JESD78 IC Latchup Test
Moisture Sensitivity Level 1
For Additional Information, see Application Note AND8003/D
Flammability Rating: UL-94 code V-0 @ 1/8", Oxygen Index 28 to 34
Transistor Count = 484 devices
Pb-Free Packages are Available

电路图、引脚图和封装图

MC10E143电路图

在线购买

型号	制造商	描述	购买
MC10E143FNR2G	ON	IC REGISTER HOLD 9BIT ECL 28PLCC	立即购买

技术资料

标题	类型	大小（KB）	下载
AC Characteristics of ECL Devices	PDF	896	点击下载
ECL Clock Distribution Techniques	PDF	54	点击下载
Interfacing Between LVDS and ECL	PDF	121	点击下载
Designing with PECL (ECL at +5.0 V)	PDF	102	点击下载
The ECL Translator Guide	PDF	142	点击下载
Odd Number Divide By Counters with 50% Outputs and Synchronous Clocks	PDF	90	点击下载
Storage and Handling of Drypack Surface Mount Device	PDF	49	点击下载
Interfacing with ECLinPS	PDF	72	点击下载

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