MC100LVEL51

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ECL Differential Clock D Flip-Flop

制造商：ON

中文数据手册

产品信息

The MC100LVEL51 is a differential clock D flip-flop with reset. The device is functionally equivalent to the EL51 device, but operates from a 3.3V supply. With propagation delays and output transition times essentially equal to the EL51, the LVEL51 is ideally suited for those applications which require the ultimate in AC performance at 3.3V V
.
The reset input is an asynchronous, level triggered signal. Data enters the master portion of the flip-flop when the clock is LOW and is transferred to the slave, and thus the outputs, upon a positive transition of the clock. The differential clock inputs of the LVEL51 allow the device to be used as a negative edge triggered flip-flop.
The differential input employs clamp circuitry to maintain stability under open input conditions. When left open, the CLK input will be pulled down to V
and the CLKbar input will be biased at V
/2.

475ps Propagation Delay
2.8GHz Toggle Frequency
ESD Protection: >4 KV HBM, >200 V MM
The 100 Series Contains Temperature Compensation
PECL Mode Operating Range: V
= 3.0 V to 3.8 V with V
= 0 V
NECL Mode Operating Range: V
= 0 V with V
= -3.0 V to -3.8 V
Internal Input Pulldown Resistors
Meets or Exceeds JEDEC Spec EIA/JESD78 IC Latchup Test
Moisture Sensitivity Level 1
For Additional Information, see Application Note AND8003/D
Flammability Rating: UL-94 code V-0 @ 1/8", Oxygen Index 28 to 34
Transistor Count = 114 devices
Pb-Free Packages are Available

电路图、引脚图和封装图

MC100LVEL51电路图

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型号	制造商	描述	购买
MC100LVEL51MNR4G	ON	IC FF D-TYPE SNGL 1BIT 8DFN	立即购买
MC100LVEL51DTR2G	ON	MC100LVEL51 是一款具有重置功能的差分时钟 D 类触发器。此器件功能与 EL51 器件相当，但由 3.3V 电源供电。LVEL51 的传播延迟和输出转换时间与 EL51 基本相当，非常适合那些要求在 3.3V VCC 下具有最高交流性能的应用。重置输入为异步、电平触发的信号。当时钟为低电平时数据进入触发器的主部分，然后传输到从部分，并因此在时钟发生正向转换时传输到输出。LVEL51 的差分时钟输入支持将器件用作下降沿触发的触发器。该差分输入采用箝位电路，以在开路输入条件下保持稳定性。保持开路时，CLK 输入将下拉至 VEE，并且 CLKbar 输入将在 VCC/2 处偏置。	立即购买
MC100LVEL51DR2G	ON	IC FF D-TYPE SNGL 1BIT 8SOIC	立即购买
MC100LVEL51DG	ON	IC FF D-TYPE SNGL 1BIT 8SOIC	立即购买

技术资料

标题	类型	大小（KB）	下载
AC Characteristics of ECL Devices	PDF	896	点击下载
ECL Clock Distribution Techniques	PDF	54	点击下载
Interfacing Between LVDS and ECL	PDF	121	点击下载
Designing with PECL (ECL at +5.0 V)	PDF	102	点击下载
The ECL Translator Guide	PDF	142	点击下载
Odd Number Divide By Counters with 50% Outputs and Synchronous Clocks	PDF	90	点击下载
ECLinPS, ECLinPS Lite, ECLinPS Plus and GigaComm Marking and Ordering Information Guide	PDF	71	点击下载
Storage and Handling of Drypack Surface Mount Device	PDF	49	点击下载

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