MC100EP210S

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5 Differential, Dual LVDS, 2.5 V

制造商：ON

中文数据手册

产品信息

The MC100EP210S is a low skew 1-to-5 dual differential driver, designed with LVDS clock distribution in mind. The LVDS or LVPECL input signals are differential and the signal is fanned out to five identical differential LVDS outputs. The EP210S specifically guarantees low output-to-output skew. Optimal design, layout, and processing minimize skew within a device and from device to device. Two internal 50-ohm resistors are provided across the inputs. For LVDS inputs, VTA and VTB pins should be unconnected. For LVPECL inputs, VTA and VTB pins should be connected to the V
(V
- 2.0 V) supply.
Designers can take advantage of the EP210S performance to distribute low skew LVDS clocks across the backplane or the board.
Special considerations are required for differential inputs under No Signal conditions to prevent instability.

20 ps Typical Output-to-Output Skew
85 ps Typical Device-to-Device Skew
550 ps Typical Propagation Delay
The 100 Series contains temperature compensation.
Maximum Frequency > 1 Ghz
Operating Range: V
= 2.375 V to 2.625 V with V
= 0 V
Internal 50Ω Input Termination Resistors
LVDS Input/Output Compatible
Pb-Free Packages are Available

电路图、引脚图和封装图

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型号	制造商	描述	购买
MC100EP210SMNG	ON	MC100EP210S 是一款低歪曲率 1:5 双路差分驱动器，在设计时考虑到了 LVDS 时钟分配。LVDS 或 LVPECL 输入信号为差分信号，并且信号被分配为五个相同的差分 LVDS 输出。EP210S 可特别保证低输出-输出歪曲率。优化的设计、布局和处理最大程度降低了器件内和器件到器件的歪曲率。整个输入提供两个内部 50 欧姆电阻。对于 LVDS 输入，应断开 VTA 和 VTB 引脚的连接。对于 LVPECL 输入，应将 VTA 和 VTB 引脚连接至 VTT（VCC-2.0 V）电源。设计人员可充分利用 EP210S 的性能，在底板或主板上分配低歪曲率 LVDS 时钟。在无信号条件下，应对差分输入进行特别考虑以防止不稳定。	立即购买
MC100EP210SMNR4G	ON	MC100EP210S 是一款低歪曲率 1:5 双路差分驱动器，在设计时考虑到了 LVDS 时钟分配。LVDS 或 LVPECL 输入信号为差分信号，并且信号被分配为五个相同的差分 LVDS 输出。EP210S 可特别保证低输出-输出歪曲率。优化的设计、布局和处理最大程度降低了器件内和器件到器件的歪曲率。整个输入提供两个内部 50 欧姆电阻。对于 LVDS 输入，应断开 VTA 和 VTB 引脚的连接。对于 LVPECL 输入，应将 VTA 和 VTB 引脚连接至 VTT（VCC-2.0 V）电源。设计人员可充分利用 EP210S 的性能，在底板或主板上分配低歪曲率 LVDS 时钟。在无信号条件下，应对差分输入进行特别考虑以防止不稳定。	立即购买
MC100EP210SFAR2G	ON	MC100EP210S 是一款低歪曲率 1:5 双路差分驱动器，在设计时考虑到了 LVDS 时钟分配。LVDS 或 LVPECL 输入信号为差分信号，并且信号被分配为五个相同的差分 LVDS 输出。EP210S 可特别保证低输出-输出歪曲率。优化的设计、布局和处理最大程度降低了器件内和器件到器件的歪曲率。整个输入提供两个内部 50 欧姆电阻。对于 LVDS 输入，应断开 VTA 和 VTB 引脚的连接。对于 LVPECL 输入，应将 VTA 和 VTB 引脚连接至 VTT（VCC-2.0 V）电源。设计人员可充分利用 EP210S 的性能，在底板或主板上分配低歪曲率 LVDS 时钟。在无信号条件下，应对差分输入进行特别考虑以防止不稳定。	立即购买
MC100EP210SFAG	ON	MC100EP210S 是一款低歪曲率 1:5 双路差分驱动器，在设计时考虑到了 LVDS 时钟分配。LVDS 或 LVPECL 输入信号为差分信号，并且信号被分配为五个相同的差分 LVDS 输出。EP210S 可特别保证低输出-输出歪曲率。优化的设计、布局和处理最大程度降低了器件内和器件到器件的歪曲率。整个输入提供两个内部 50 欧姆电阻。对于 LVDS 输入，应断开 VTA 和 VTB 引脚的连接。对于 LVPECL 输入，应将 VTA 和 VTB 引脚连接至 VTT（VCC-2.0 V）电源。设计人员可充分利用 EP210S 的性能，在底板或主板上分配低歪曲率 LVDS 时钟。在无信号条件下，应对差分输入进行特别考虑以防止不稳定。	立即购买

技术资料

标题	类型	大小（KB）	下载
AC Characteristics of ECL Devices	PDF	896	点击下载
ECL Clock Distribution Techniques	PDF	54	点击下载
Interfacing Between LVDS and ECL	PDF	121	点击下载
Designing with PECL (ECL at +5.0 V)	PDF	102	点击下载
The ECL Translator Guide	PDF	142	点击下载
Odd Number Divide By Counters with 50% Outputs and Synchronous Clocks	PDF	90	点击下载
ECLinPS, ECLinPS Lite, ECLinPS Plus and GigaComm Marking and Ordering Information Guide	PDF	71	点击下载
Storage and Handling of Drypack Surface Mount Device	PDF	49	点击下载

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