MC100LVEL05

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ECL 2-Input Differential AND/NAND Gate

制造商：ON

中文数据手册

产品信息

The MC100LVEL05 is a 2-input differential AND/NAND gate. The device is functionally equivalent to the MC100EL05 device and operates from a 3.3V supply voltage. With propagation delays and output transition times equivalent to the EL05, the LVEL05 is ideally suited for those applications which require the ultimate in AC performance at low voltage power supplies.
Because a negative 2-input NAND is equivalent to a 2-input OR function, the differential inputs and outputs of the device allows the LVEL05 to also be used as a 2-input differential OR/NOR gate.

340ps Propagation Delay
High Bandwidth Output Transitions
ESD Protection: >4 KV HBM, >200 V MM
The 100 Series Contains Temperature Compensation
PECL Mode Operating Range: V
= 3.0 V to 3.8 V with V
= 0 V
NECL Mode Operating Range: V
= 0 V with V
= -3.0 V to -3.8 V
Internal Input Pulldown Resistors
Q Output will Default LOW with All Inputs Open or at V
Meets or Exceeds JEDEC Spec EIA/JESD78 IC Latchup Test
Moisture Sensitivity Level 1
For Additional Information, see Application Note AND8003/D
Flammability Rating: UL-94 code V-0 @ 1/8", Oxygen Index 28 to 34
Transistor Count = 69 devices
Pb-Free Packages are Available

电路图、引脚图和封装图

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型号	制造商	描述	购买
MC100LVEL05DTG	ON	IC GATE AND/NAND ECL 2INP 8TSSOP	立即购买
MC100LVEL05DTR2G	ON	IC GATE AND/NAND ECL 2INP 8TSSOP	立即购买
MC100LVEL05DR2G	ON	IC GATE AND/NAND ECL 2INP 8-SOIC	立即购买
MC100LVEL05DG	ON	IC GATE AND/NAND ECL 2INP 8SOIC	立即购买

技术资料

标题	类型	大小（KB）	下载
AC Characteristics of ECL Devices	PDF	896	点击下载
ECL Clock Distribution Techniques	PDF	54	点击下载
Interfacing Between LVDS and ECL	PDF	121	点击下载
Designing with PECL (ECL at +5.0 V)	PDF	102	点击下载
The ECL Translator Guide	PDF	142	点击下载
Odd Number Divide By Counters with 50% Outputs and Synchronous Clocks	PDF	90	点击下载
ECLinPS, ECLinPS Lite, ECLinPS Plus and GigaComm Marking and Ordering Information Guide	PDF	71	点击下载
Storage and Handling of Drypack Surface Mount Device	PDF	49	点击下载

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