MC100LVEL31

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ECL D Flip-Flop with Set and Reset

制造商：ON

中文数据手册

产品信息

The MC100LVEL31 is a D flip-flop with set and reset. The device is functionally equivalent to the EL31 device but operates from a 3.3V supply.With propagation delays and output transition times essentially equivalent to the EL31, the LVEL31 is ideally suited for those applications which require the ultimate in AC performance at low power supply voltages.
Both set and reset inputs are asynchronous, level triggered signals. Data enters the master portion of the flip-flop when clock is LOW and is transferred to the slave, and thus the outputs, upon a positive transition of the clock.

475ps Propagation Delay
2.9GHz Toggle Frequency
ESD Protection: >4 KV HBM, >200 V MM
The 100 Series Contains Temperature Compensation
PECL Mode Operating Range: V
= 3.0 V to 3.8 V with V
= 0 V
NECL Mode Operating Range: V
= 0 V with V
= -3.0 V to -3.8 V
Internal Input Pulldown Resistors
Meets or Exceeds JEDEC Spec EIA/JESD78 IC Latchup Test
Moisture Sensitivity Level 1
For Additional Information, see Application Note AND8003/D
Flammability Rating: UL-94 code V-0 @ 1/8", Oxygen Index 28 to 34
Transistor Count = 121 devices
Pb-Free Packages are Available

电路图、引脚图和封装图

MC100LVEL31电路图

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型号	制造商	描述	购买
MC100LVEL31DTG	ON	IC FF D-TYPE SNGL 1BIT 8TSSOP	立即购买
MC100LVEL31DTR2G	ON	IC FF D-TYPE SNGL 1BIT 8TSSOP	立即购买
MC100LVEL31DR2G	ON	IC FF D-TYPE SNGL 1BIT 8SOIC	立即购买
MC100LVEL31DG	ON	3.3 V ECL D触发器，带设置和复位 SOIC8	立即购买

技术资料

标题	类型	大小（KB）	下载
AC Characteristics of ECL Devices	PDF	896	点击下载
ECL Clock Distribution Techniques	PDF	54	点击下载
Interfacing Between LVDS and ECL	PDF	121	点击下载
Designing with PECL (ECL at +5.0 V)	PDF	102	点击下载
The ECL Translator Guide	PDF	142	点击下载
Odd Number Divide By Counters with 50% Outputs and Synchronous Clocks	PDF	90	点击下载
ECLinPS, ECLinPS Lite, ECLinPS Plus and GigaComm Marking and Ordering Information Guide	PDF	71	点击下载
Storage and Handling of Drypack Surface Mount Device	PDF	49	点击下载

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